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「技术文章」基于FPGA的数字分频器设计
**摘要：**在设计数字电路过程中，通常所需的频率要根据给定的频率进行分频来得到。时钟分频又分为整数分频和小数分频，有时还有会有分数分频。
英特尔CPU机密数据大量泄露：芯片后门实锤，下一代CPU原理图曝光
泄露内容可谓触目惊心，不仅包括英特尔还未发布的Tiger Lake笔记本CPU的原理图、固件，还有各种芯片的开发调试工具包，等于把英特尔家底完全暴露。
RTL代码完全免费下载！西部数据推出两款RISC-V，内核完全免费公开
本文由EETOP翻译自：anandtech西部数据（Western Digital）已在其SweRV微控制器CPU 产品组合中增加了两个新的处理器内核-SweRV Core EH2和SweRV Core EL2 。
「精品博文」FPGA定点小数计算（Verilog版）第三篇——除法运算
**定点小数除法运算，相比加法和乘法来说要复杂很多了，但是算法的基本思想还是很简单的。和整数除法类似，算法的核心思想就是，将除法运算转换为移位和减法运算。
一个“小白”的PLL学习实录——锁相环从入门到进阶到“放弃”（更新版）
之后论坛里又有了相应的更新，现在重新整理更新给大家。帖子地址： http://bbs.eetop.cn/thread-606264-1-1.html
RTL代码免费下载！西部数据推出两款RISC-V，内核完全免费公开
西部数据（Western Digital）已在其SweRV微控制器CPU产品组合中增加了两个新的处理器内核-SweRV Core EH2和SweRV Core EL2 。
Low power RTL 设计优化，同等工艺下让你的设计功耗更低!
工艺的提升带来的收益可能远比RTL深度优化高，如TSMC 40LP vs TSMC 28HPC+, 后者基本上比前者面积小一半，速度快一倍，dynamic power小40~50%，代价是leakage高3~4倍。